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• 억제 회로, 抑制回路, inhibit circuit

  두 개의 입력 단자 A, B와 한 개의 출력 단자 C가 있고 A에 입력 1, B에 입력 0이 가해졌을 경우에만 C에 출력 1이 나타나는 회로. 표에 억제 회로의 입력값과 출력값의 관계를 나타냈다. 이와 같이 ‘A와 B로 억제하는’ 함수를 실현하기 때문에 억제 회로라고 한다.